近日，英特尔公布项名为XBM的带宽内存利本领，旨在成为HBM4的替代案，有望提供的带宽和低的本钱。据wccftech报说念，这项本领的生意化时间预测将在2030年之后。

　　XBM（eXtended Bandwidth Memory），全称推广带宽内存，属于DRAM内存案，其封装尺寸将与HBM4保执致丽江隔热条设备，每颗芯片的容量可在0.5GB-5GB之间，搭载32GT/s速度的UCIe通用芯粒互贯串口。

　　XBM中枢的校正在于重构了芯片底层架构。传统DRAM的存储单位制作于前段制程（FEOL），也便是原生用于制作晶体管的底层硅基底；而XBM将1T1C存储单位转移至后段制程（BEOL），叮嘱在晶体管表层的金属通孔堆叠区域，并采用薄膜晶体督工艺。

芯片堆叠的歪斜睨图丽江隔热条设备，领路了跨层的对王人数据块和TSV

　　这种后说念集成存储单位的想象，能大幅普及芯单方面积讹诈率，容纳多硅通孔（TSV），有拉内存集成密度与带宽上限，这也契英特尔历久行的“存储层叠于逻辑电路上”的后说念晶体管本领门路。

　　值得介怀的是，该利的侧不在于存储单位自己，而在于定制化封装案：英特尔出封装集成内存（MoP）与反向悬垂结构，化Z轴堆叠度。传统MoP会增多300-350微米厚度丽江隔热条设备，新结构可镌汰堆叠度，取消翘曲加固筋，由电压治疗器平直为DRAM供电，完好意思小体积、低本钱的封装方式。

封装内存横截面图，芯片堆叠位于SoC模块两侧

　　在硬件规格上丽江隔热条设备，XBM由封装基板、可选基底芯片和堆叠存储芯片阵列组成，举座封装尺寸与HBM4保执致；其责任频率为2GHz，依靠子通说念数目与堆叠层数适度数据块限制，依托架构和封装双重化，塑料管材生产线八成在小的硬件体积内完好意思的带宽与存储容量。

　　带宽内存（HBM）将DRAM芯片垂直堆叠在底层逻辑芯片上，通过TSV完成芯片互联，并借助硅中介层，以宽并行接口与管制器进行数据通讯，单堆叠位宽可达1024位。该大位宽是HBM完好意思带宽的中枢，但也平直致其封装本钱、推广受限，根源在于通盘信号走线都须穿过内存与诡计芯片之间的硅中介层。

　　跟着AI加快器算力增速远内存读写能增速，这类内存墙仍是制约举座能，因此当今主流芯片厂商均将研发要点放在内存接口与堆叠架构化上，而非单纯迭代逻辑芯片。

　　业界均紧锣密饱读征询HBM替代案。

　　英特尔此前进过多款DRAM存储研发名目，举例混内存立体（HMC）与多通说念DRAM（MCDRAM），均碰到万般本领疼痛，恒久未能完好意思量产上市。借助XBM案，英特尔正在调整自身DRAM存储研发门路。

　　当今，英特尔至少在并行建立两种HBM替代案，除了XBM，还有ZAM（Z角存储器）案，ZAM是英特尔与软银子公司SAIMEMORY联建立的架构，缱绻在2026年大限制集成电路推敲会上展示。

　　ZAM的革命之处在于键本领——采用熔键本领，将九层DRAM堆叠在起，层间硅层厚度约为3微米，层间硅层厚度也约为3微米。据报说念，其带宽密度约为HBM4的两倍，生意化认识时间为2029年。

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